飞思卡尔的FLL频率怎么确定？

eekarenzhang · 发表于 2011-9-2 21:03:27

我知道飞思卡尔的总线频率是FLL频率的一半？那么FLL的频率是怎么确定的？
谢谢！

我知道答案目前已有4人回答

安 · 发表于 2011-9-2 22:28:19

这个你可以参考手册时钟频率这一章，这个是根据时钟寄存器的配置参数来设置FLL。

eekarenzhang · 发表于 2011-9-2 22:30:22

我刚刚看了个飞思卡尔MCU时钟模块配置，有外部振荡器，内部参考时钟，锁频环之类的
上面讲的FLL会有512的倍频，然后外部振荡器最高频率是5MHZ
可是为什么我的那个单片机开发板上的那个OSC从外面的标识来看是12M的呢？
这不是矛盾吗？我有点不大明白

安 · 发表于 2011-9-3 12:31:52

MCU的最高频率是5M，因为你的OSC可能不同，所以这里可以通过内部时钟寄存器来配置。当然，配置的寄存器的值，要在指定的范围以内。

eekarenzhang · 发表于 2011-9-3 13:47:49

回复第 4 楼于2011-09-03 04:31:52发表:
MCU的最高频率是5M，因为你的OSC可能不同，所以这里可以通过内部时钟寄存器来配置。当然，配置的寄存器的值，要在指定的范围以内。

为什么MCU的最高频率是5M的？
那是不是接外部振荡器以后，经过分频，频率也必须在31.25KHZ到39.065KHZ之间呢？然后该频率经过512倍频之后，是16M到20M，然后再经过分频，所以总线频率是2M，4M，8M，……，之类的，难道就不能设置成3M之类的嘛？非要是那几个固定的频率吗？
欢迎指教！不是很明白！谢谢！

mickeytest-1827 · 发表于 2011-9-3 18:00:40

具体一点还是请你把型号说出来。
5MHZ是最高频率?安版主会不会看错资料了，依型号不同至少都可以到20MHZ或40MHZ。
31.25~39.065KHZ和外部晶振没关系的，这是内部振荡的可调范围。

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