请教个9S08SG8芯片，时钟设置为FBELP模式的问题！！

Ares143-165728 · 发表于 2012-1-10 10:32:16

我选用的MCU是9S08SG8，用了10.368M的外部晶振，根据datasheet应该只能设置为FBELP模式，请问这个模式下，应该如何设置时钟配置，总线时钟和外部晶振是怎么样的关系？假设BDIV设置为00（总线分频为1）。

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Ares143-165728 · 发表于 2012-1-10 11:04:19

没人气啊！

安 · 发表于 2012-1-10 14:09:24

和外部连接8M晶振的配置是一样的。先分频、再倍频。
时钟不行你可以同PE生成代码，这个方式最简单了。

Ares143-165728 · 发表于 2012-1-10 16:06:58

回复第 3 楼于2012-01-10 06:09:24发表:
和外部连接8M晶振的配置是一样的。先分频、再倍频。
时钟不行你可以同PE生成代码，这个方式最简单了。

SG08的FEE模式最大是4-5M的晶振，8M也是超出范围了，所以我用了FBELP模式，在这个模式下，对晶振分频没有任何效果。而且奇怪的是，我现在的总线时钟是6.51M（可能是6.5M）或者是其倍数，我不知道是怎么出来的。

安 · 发表于 2012-1-10 17:16:50

你可以使用PE生成代码，然后和你的代码对比一下，看看有什么不一样的。

雨袖飘风 · 发表于 2012-2-22 19:45:48

使用内部频率的好像只是datasheet的一半要不就是我下的dasheet有问题如果是一半的关系应该就对了

雨袖飘风 · 发表于 2012-2-22 19:47:14

官网上好像有个设置ICS的文档什么名字我忘了就是上面的公式

dadou25-261098 · 发表于 2012-3-6 13:39:01

就像附上的原理图红色的标线显示的去配置ICSC1和ICSC2寄存器,
ICSC2 赋值#$00, ICSC1赋值#$80, ICSOUT除以2是bus Clk，所以即使BDIV设置成00的话，得到的bus也只有外部时钟的一半。
不知道回答的对不对，一起研究研究。

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