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FSL_TICS_TIANZH · 发表于 2013-5-17 12:46:33

上图是UART波特率的设置和计算公式。

FSL_TICS_TIANZH · 发表于 2013-5-17 12:48:52

上图是ISO-7816的初始化需要设置的寄存器。

FSL_TICS_TIANZH · 发表于 2013-5-17 12:53:16

上图中是UART在RS232模式下的信号硬件连接图。

FSL_TICS_TIANZH · 发表于 2013-5-17 12:57:25

上图为UART在RS485模式下的信号硬件连接图。

FSL_TICS_TIANZH · 发表于 2013-5-17 12:59:58

上图UART在ISO-7816模式下硬件信号的连接方式图。

FSL_TICS_TIANZH · 发表于 2013-5-17 13:02:39

上图为UART模块在红外模式下的信号硬件连接图。

FSL_TICS_Kan · 发表于 2013-5-17 14:16:31

ADC与PDB篇（续）

PDB可视为一个计数器模块，它的特殊之处在于它接收外部的触发信号，并且计数时会和多个数值进行比较，并在每次匹配的时间点输出相关的触发信号，从而触发ADC等模块或运行相关的中断服务程序。

上图可以看到一个PDB通道只有一个trigger信号，却有多个pre-trigger信号，其实两者之间的延迟只有一个peripheral clock，pre-trigger的作用可以理解为选中对应的ADC模块配置，从前文我们知道ADC模块有多个SC1n的寄存器，目前的版本支持SC1A和SC1B, pre-trigger 0 可以理解为选中SC1A对应的ADC，pre-trigger 1 可以理解为选中SC1B对应的ADC，选中配置后再由trigger信号触发对应的ADC采样。

FSL_TICS_Kan · 发表于 2013-5-17 14:28:45

上图的Trigger A/B可以看做pre-trigger和trigger的组合逻辑。这里要注意的是pre-trigger的周期设置要大于ADC的转换时间，否则不但无法触发ADC采样，反而会产生一个PDB sequence error的中断。

利用PDB的特性，可以在极短的时间内触发两次ADC采样，即上图的ping-pong模式。这里PDB的计数器会和三个数进行比较，当计数器累加到triggerA的设定时间时，会触发ADC A的转换，当计数器累加到triggerB的设定时间时，会触发ADC B的转换，最后计数到PDB的MOD值时，产生中断，并在中断服务程序里清楚ADC的COCO标志。

ADC与PDB篇--完