例程中如何提高bus clock到48M？ 谢谢！！（已解决）

magni-2019594

目前考虑提高bus clock，将默认的24M提高到48M，参考手册，
试图修改例程函数sysinit ()中如下部分，文件Sysinit.c的63行。
修改前：
SIM_CLKDIV1 = ( 0
| SIM_CLKDIV1_OUTDIV1(0)
| SIM_CLKDIV1_OUTDIV4(1) );
修改后
SIM_CLKDIV1 = ( 0
| SIM_CLKDIV1_OUTDIV1(0)
| SIM_CLKDIV1_OUTDIV4(0) ); //修改此处
上述修改，重新编译出来，下到flash 中发现bus clock未有变化。
请问是不是配置方法不对，或者配置的位置不对。
另外，打印如下的数据都为零，如果为零，应该系统不能正常工作吧。
mcg_clk_khz =0;
core_clk_khz = 0；
periph_clk_khz =0;

麻烦高手们尽快给我解释下啊，谢谢！！
 

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magni-2019594

顶下。不顶不行啊

FSL_TICS_MAHUI

你所用代码，配置了core时钟和Flash时钟。 OUTDIV4是配置Flash时钟，不能超过25MHz。这是问题所在。
SIM_CLKDIV1 = ( 0
| SIM_CLKDIV1_OUTDIV1(0)
| SIM_CLKDIV1_OUTDIV4(1) );
 
你需要使用下面的代码配置core时钟，bus时钟为48MHz，Flash时钟为24MHz。
SIM_CLKDIV1 = ( 0
| SIM_CLKDIV1_OUTDIV1(0)
| SIM_CLKDIV1_OUTDIV2(0)

| SIM_CLKDIV1_OUTDIV4(1) );
 
祝顺利。
 

magni-2019594

谢谢！！不过今天一个公司的FAE工程师告诉我，bus clock最高配置为24M，那这个说法就是不对的了吗？
麻烦确认下，谢谢！！

FSL_TICS_TIANZH

你好，如果你使用的是Kinetis的K系列的，按照3楼的方法配置就可以了。如果你使用的是Kinetis的L系列的，最高的bus clock就是24MHz。

星星-418393

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afei9527

顶下。不顶不行啊