客户问题：KL25如何使PTB0输出高电平

FSL_TICS_MAHUI · 发表于 2013-11-6 14:23:17

首先在控制KL25 PORTB管脚之前，需要设置SIM_SCGC5寄存器【PORTB】位，使能PORTB的时钟，这样才能访问PORTB对应的寄存器。
然后，配置PORTB_PCRn寄存器，例如PORTB_PCR0寄存器来设置PTB0，配置这个管脚为GPIO功能（设置【MUX】为0x1）。
然后，可以通过配置GPIOB_PDDR寄存器对应为，是PTB0作为GPIO输出管脚，最后通过GPIOB_PDOR寄存器来设置输出电平为高还是低。

请参考附件中的例程关于如何配置KL25 PTB0管脚作为GPIO输出高电平。
KL25_PTB0.zip (156.14 KB, 下载次数: 9)

cmxeefocus · 发表于 2013-11-7 10:22:06

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FSL_TICS_ZP · 发表于 2013-11-11 10:32:50

回复第 2 楼于2013-11-07 10:22:06发表:
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谢谢关注飞思卡尔的产品，祝顺利！！

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