felxio dma传输数据有间隔

402227912 · 发表于 2020-9-10 14:25:26

使用MXRT1011系列 SDK_2.8.0 中的edma_transfer\fsl_flexio_mculcd_edma.c 进行数据传输，使用逻辑分析仪发现每传输一组shiftbuff的数据有很明显的延时，正常4个SHIFTBUF传输一组数据是1us左右，可以传输完成4个SHIFTBUF数据后竟然还延时1us ,30K的数据就多出20ms了，请问如何避免这种情况

逻辑分析仪

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小恩GG · 发表于 2020-9-14 13:59:10

能否分享一下具体代码

402227912 · 发表于 2020-9-16 09:02:02

我就是直接使用的 MXRT1011系列 SDK_2.8.0 的库啊，没有自己的代码

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