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[求助] 请教一下高速4370的adc电压转换问题

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发表于 2025-1-26 15:22:01 | 显示全部楼层 |阅读模式
我这边在调官方hsadc的例程,然后我测试了0-1.2v之间的电压,0电压的时候是2048,0.4v是3700多,这里和论坛一位老哥发的贴的内容是一致的。但是我试了一下到了0.7v又掉到了1200多,好像并不线性,没看懂为什么会这样子。那个贴子里有位老哥给出的公式是d_out = 2048 x (vin_pos - vin_neg)/400 mV,但是带进去好像不太对。主要是他这个结果不是线性的让我很迷惑,是我硬件出问题了吗?

最佳答案

DCINNEG设置为1时,采用的是内部直流偏置,此时Vneg固定是500mV,ADC0输入700mV时,带入公式(700-500)/400*2048=1024.关于输入电压问题:Vin_pos=[Vin_neg-400,Vin_neg+400],单位mV。 ...
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 楼主| 发表于 2025-1-26 15:28:56 | 显示全部楼层
难道是从2048开始,然后到了4096就清零又从0开始?
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    发表于 2025-1-26 22:48:52 | 显示全部楼层
    难道不能查下官方技术文档吗?
    哎...今天够累的,签到来了~
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    发表于 2025-2-11 14:44:19 | 显示全部楼层
    这个高速的ADC需要考虑阻抗匹配的,我怕是阻抗不匹配导致的
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     楼主| 发表于 2025-2-11 16:39:12 | 显示全部楼层
    mgn 发表于 2025-2-11 14:44
    这个高速的ADC需要考虑阻抗匹配的,我怕是阻抗不匹配导致的

    好像不是,看着和输入方式有关。按照例程的readme,只让我连接hsdac的0通道,查手册的话看到还有个差分输入neg的引脚,把这个接地就会从0开始了,但是电压到0.8出头读数就上不去了。而且不管哪一种输入方式,好像都是12m的采样速率,上不到80
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    发表于 2025-2-21 17:51:33 | 显示全部楼层
    DCINNEG设置为1时,采用的是内部直流偏置,此时Vneg固定是500mV,ADC0输入700mV时,带入公式(700-500)/400*2048=1024.关于输入电压问题:Vin_pos=[Vin_neg-400,Vin_neg+400],单位mV。
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    发表于 2025-2-21 18:02:40 | 显示全部楼层
    目前我也在使用这个单片机测试,但是ADC值不稳定,达不到说明书的12位ADC稳定10位ADC的要求,现在只能稳定8-9位,不知道什么原因。
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     楼主| 发表于 2025-2-25 08:46:29 | 显示全部楼层
    eefocus_4072698 发表于 2025-2-21 18:02
    目前我也在使用这个单片机测试,但是ADC值不稳定,达不到说明书的12位ADC稳定10位ADC的要求,现在只能稳定8 ...

    老哥,请问一下你采样速率能上到40m或者80m吗?我这边卡在12m上不去可以请教一下改调整哪里的时钟或者参数吗?
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     楼主| 发表于 2025-2-25 08:48:31 | 显示全部楼层
    eefocus_4072698 发表于 2025-2-21 17:51
    DCINNEG设置为1时,采用的是内部直流偏置,此时Vneg固定是500mV,ADC0输入700mV时,带入公式(700-500)/400* ...

    谢谢老哥提供信息,我再去试试
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    发表于 2025-2-25 19:13:42 | 显示全部楼层
    eefocus_4078887 发表于 2025-2-25 08:46
    老哥,请问一下你采样速率能上到40m或者80m吗?我这边卡在12m上不去可以请教一下改调整哪里的时钟或者参 ...

    官方代码只能12M,要自己配才行:
                Chip_USB0_Init();/*将USB0 PLL初始化为480 MHz */
                Chip_Clock_SetDivider(CLK_IDIV_A,CLKIN_USBPLL,3); /*来自USB0PLL的DIV_A源,并将分频器设置为2(支持的最大div值为4)[IN 480 MHz;输出240 MHz */
                Chip_Clock_SetDivider(CLK_IDIV_B,CLKIN_IDIVA,2); /*来自DIV_A的源DIV_B,[IN 240 MHz;输出80 MHz */
                Chip_Clock_SetBaseClock(CLK_BASE_ADCHS, CLKIN_IDIVB, true, false); /* Source ADHCS base clock from DIV_B */
                ulFreqHSADC = Chip_HSADC_GetBaseClockRate(LPC_ADCHS);
                Chip_Clock_EnableOpts(CLK_MX_ADCHS, true, true, 1);/*启用寄存器时钟*/
                Chip_Clock_Enable(CLK_ADCHS); /*启用时钟*/
            Chip_RGU_TriggerReset(RGU_ADCHS_RST);
            while(Chip_RGU_InReset(RGU_ADCHS_RST)){}
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