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[求助] 急急急!1052 Jlink连接不上(Jflash连接不上)

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  • TA的每日心情
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    2021-3-29 16:57
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    发表于 2021-3-29 16:56:58 | 显示全部楼层 |阅读模式
    菜鸟一枚,请各位大佬指教!
    项目中用到1052硬件,硬件工程师没有将boot_mode的两pin做处理悬空着在,现在Jlink和Jflash均连不上去;

    有两个疑问:
    1.boot_mode两个引脚悬空时,Jlink和Jflash是否能连上;
    2.若连接不上,能否有其他补救措施?





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  • TA的每日心情
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     楼主| 发表于 2021-3-29 17:22:27 | 显示全部楼层
    有没有人哇
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    发表于 2021-3-30 13:46:56 | 显示全部楼层
    你的说的boot_mode引脚做了什么处理呢,为什么要悬空呢?
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  • TA的每日心情
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    发表于 2021-3-30 16:15:38 | 显示全部楼层
    boot_mode是选择启动方式的,如果没接影响代码的启动位置,应该不影响jlink连接。
    然后RT1052芯片至少要使用V9以上的jlink才行。
    不过你悬空的话,板子还是重新设计吧
    该会员没有填写今日想说内容.
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     楼主| 发表于 2021-3-31 09:10:43 | 显示全部楼层

    硬件工程师是个新手,中间又转了一手,后来检视的时候没注意这点,就悬空着在;
    现在通过示波器测量JTAG的CLK信号一直是个高电平;
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     楼主| 发表于 2021-3-31 09:11:23 | 显示全部楼层
    小恩GG 发表于 2021-3-30 13:46
    你的说的boot_mode引脚做了什么处理呢,为什么要悬空呢?


    硬件工程师是个新手,中间又转了一手,后来检视的时候没注意这点,就悬空着在;
    现在通过示波器测量JTAG的CLK信号一直是个高电平;
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     楼主| 发表于 2021-3-31 09:27:15 | 显示全部楼层
    az158 发表于 2021-3-30 16:15
    boot_mode是选择启动方式的,如果没接影响代码的启动位置,应该不影响jlink连接。
    然后RT1052芯片至少要使 ...

    现在通过示波器测量JTAG的CLK信号一直是个高电平;

    使用的Jlink可以正常连接NXP官方的的demo板,也可以烧录程序;

    是,我们正在确认修改方案
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    发表于 2021-3-31 11:08:09 | 显示全部楼层
    xujw 发表于 2021-3-31 09:27
    现在通过示波器测量JTAG的CLK信号一直是个高电平;

    使用的Jlink可以正常连接NXP官方的的demo板,也可以 ...

    可以的话,飞线连接两个boot_mode引脚来控制启动方式,但是J-link连接与boot_mode引脚应该是不互相影响的,建议再检查一下板子的硬件电路
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     楼主| 发表于 2021-3-31 16:51:11 | 显示全部楼层
    小恩GG 发表于 2021-3-31 11:08
    可以的话,飞线连接两个boot_mode引脚来控制启动方式,但是J-link连接与boot_mode引脚应该是不互相影响的 ...

    BGA封装的,飞线比较困难;外围的电源和晶振都测试过没问题;
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     楼主| 发表于 2021-3-31 16:52:47 | 显示全部楼层
    小恩GG 发表于 2021-3-31 11:08
    可以的话,飞线连接两个boot_mode引脚来控制启动方式,但是J-link连接与boot_mode引脚应该是不互相影响的 ...

    悬空的,boot_mode默认的是高电平还是低电平?
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